Breaking trapping sets using targeted bit adjustment

申请公布号：US8458555(B2)

申请号：US20100827652

申请日期：2010.06.30

申请公布日期：2013.06.04

申请人：

GUNNAM KIRAN;LSI CORPORATION

发明人：GUNNAM KIRAN

分类号：H03M13/00

主分类号：H03M13/00

摘要：In one embodiment, an LDPC decoder performs a targeted bit adjustment method to recover a valid codeword after the decoder has failed. In a first stage, a post processor initializes the decoder by saturating LLR values output by the decoder during the last (i.e., failed) iteration to a relatively small value. Then, two-bit trials are performed, wherein LLR values corresponding to two bits of the codeword are adjusted in each trial. Decoding is performed with the adjusted values, and if the number of unsatisfied check nodes exceeds a specified threshold, then a second stage is performed. The post processor initializes the decoder by saturating the LLR values output by the decoder during the last (i.e., failed) iteration of the first stage to a relatively small value. The second stage then performs single-bit adjustment trials, wherein one LLR value corresponding to one bit of the codeword is adjusted in each trial.

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